PLD カイロカ ノ タメ ノ クミアワセ ロンリ カイロ
PLD回路化のための組合せ論理回路 / 村田裕著
データ種別 | 図書 |
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出版者 | 東京 : 共立出版 |
出版年 | 1998.4 |
大きさ | viii, 238p ; 22cm |
所蔵情報を非表示
配架場所 | 巻 次 | 請求記号 | 資料番号 | 状 態 | コメント | 予約 | 文庫区分 | 教員指定/教員執筆/多読 | 仮想書架 |
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ラーネッド記念図書館 第3開架 |
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549.3||M739 | 980206915 |
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書誌詳細を非表示
書誌ID | BB00382009 |
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本文言語 | 日本語 |
別書名 | 異なりアクセスタイトル:PLD回路化のための組合せ論理回路 異なりアクセスタイトル:組合せ論理回路 : PLD回路化のための |
一般注記 | 「精解ディジタル回路工学 1」(1986年刊)の改題改訂 |
著者標目 | 村田, 裕 <ムラタ, ユタカ> |
件 名 | BSH:電子回路 |
分 類 | NDC8:549.3 NDC9:549.3 |
巻冊次 | ISBN:4320085213 ; PRICE:\3400 RefWorks出力(各巻) |
NCID | BA35809180 |
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